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[主观题]

用同步十进制计数器74160设计一个可变进制计数器,要求在控制信号M=0时为五进制,而在M=1时为七进制。可以附加必要的门电路。请标明计数输入端与进位输出端。

用同步十进制计数器74160设计一个可变进制计数器,要求在控制信号M=0时为五进制,而在M=1时为七进制。可以附加必要的门电路。请标明计数输入端与进位输出端。

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第1题
用同步十六进制计数器74163设计一个可变进制计数器,要求在控制信号M=0时为十进制,而在M=1时为十二进制。可以附加必要的门电路。请标明计数输入端与进位输出端。
用同步十六进制计数器74163设计一个可变进制计数器,要求在控制信号M=0时为十进制,而在M=1时为十二进制。可以附加必要的门电路。请标明计数输入端与进位输出端。

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第2题
图P6.20是用两个同步十进制计数器74160组成的计数电路。试说明这个电路是几进制计数电路。进位输出
脉冲的宽度是时钟信号周期的几倍?

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第3题
图5.28(a)所示电路为同步十进制加法计数器74160和3-8译码器74138组成的电路,74138输出低电平
图5.28(a)所示电路为同步十进制加法计数器74160和3-8译码器74138组成的电路,74138输出低电平

有效,使能端处于有效状态.

(1)74160构成多少进制计数器.

(2)假定74160初始状态Q3Q2Q1Q0=0000,试对应图5.28(b)的CP脉冲图画出Q3、Q2、Q1、Q0和Y的输出波形.

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第4题
试分析图4所示的计数器在M=1和M=0时各为几进制。同步十进制加法计数器74160的功能表如表1所示。

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第5题
试用同步十进制加法计数器74LS160设计一个四十八进制计数器.74LS160的功能表如表6-4.

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第6题
试用中规模同步十进制加法计数器CT74160,并附加必要的门电路,设计一个273进制计数器.

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第7题
用T触发器作为存储元件,设计一个采用8421码的十进制加1计数器。

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第8题
用ISP技术设计一个可控计数器.当控制信号X=0时,为8421码十进制计数器;当X=1时,为4位二进制计数器.用VHDL语言写出设计源文件.

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第9题
用触发器和门电路设计一个2421码的十进制计数器。请标明计数输入端和进位输出端。计数过程中2421码的变化顺序如表1.2.1中所示。

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第10题
用JK触发器设计一个同步六进制加1计数器。

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第11题
用JK触发器及最少的门电路设计一个同步五进制计数器,其状态Q2Q1Q0的转换图如图P5.
9所示.

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