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[主观题]

试利用两片4位二进制并行加法器741S283和必要的门电路.组成1位二-是进制加法器电路.(根据二-十进制数的加法运算规则,当两数之和小于、等于9(1001)时,相加的结果和按二进制数相加所得到的结果一样.当两数之和大于9(即等于1010~111)时,则应在按二进制数相加的结果上加6(0110),这样就以给出进位信号,同时得到一个小于9的和.)

试利用两片4位二进制并行加法器741S283和必要的门电路.组成1位二-是进制加法器电路.（根据二-十进制数的加法运算规则,当两数之和小于、等于9（1001)时,相加的结果和按二进制数相加所得到的结果一样.当两数之和大于9（即等于1010~111)时,则应在按二进制数相加的结果上加6（0110),这样就以给出进位信号,同时得到一个小于9的和.)

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更多“试利用两片4位二进制并行加法器741S283和必要的门电路.…”相关的问题

第1题

由两片SN54/74LS161（同步4位二进制计数器)组成的同步计数器如图5.22所示.1)试分析其分频比（即Y

由两片SN54/74LS161(同步4位二进制计数器)组成的同步计数器如图5.22所示.

1)试分析其分频比(即Y与CP之频比),当CP的频率为20kHz时,Y的频率为多少？

2)试用2片SN54/74LS161组成模为91的计数器,要求两片间用级联法,并工作可靠.

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第2题

有一个十进制数加法运算系统,它利用4位二进制数加法器对一位8421BCD码进行加法运算.其操作过程如下:先将两个1位十进制数存入寄存器A和B,然后进行相加.如果和数等于或小于9,则运算结果正确;如果和数大于10,还需要对运算结果进行加6(0110)修正,这是因为用二进制数表示十进制数时,多余了6种状态.(1)请设计系统方框图;(2)请设计ASM流程图.

有一个十进制数加法运算系统,它利用4位二进制数加法器对一位8421BCD码进行加法运算.其操作过程如下:先将两个1位十进制数存入寄存器A和B,然后进行相加.如果和数等于或小于9,则运算结果正确;如果和数大于10,还需要对运算结果进行加6（0110)修正,这是因为用二进制数表示十进制数时,多余了6种状态.（1)请设计系统方框图;（2)请设计ASM流程图.

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第3题

用四位二进制并行加法器实现8421码转换成余3码的代码转换电路，是将输入8421码加上（）。

A.1100

B.0011

C.0001

D.0010

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第4题

图10.66所示为四位二进制加法计数器,其功能表见表10.16所示.试将两片CT74161采用同步级联方式

及总体反馈归零法设计成一个23进制计数器,要求写出设计过程并画出连接图.

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第5题

试分析图题6.5.14所示计数器，画出它的状态图，并确定它的模。（74xx163是具有同步清零功能的4位

试分析图题6.5.14所示计数器，画出它的状态图，并确定它的模。(74xx163是具有同步清零功能的4位同步二进制递增计数器，其他功能与74xx161相同)

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第6题

图P3.17电路是由一片4位二进制超前进位全加器74283、比较器7485与七段显示译码电路7448及显示

块LED组成的电路,试分析该电路的逻辑功能.

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第7题

要利用两片集成计数器构成一个24进制计数器,可（)。

A.用一片集成计数器构成三进制,另一片构成八进制,然后串行连接即可

B.用一片集成计数器构成十二进制,另一片也构成十二进制,然后串行连接即可

C.用一片集成计数器构成四进制,另一片构成六进制,然后串行连接即可

D.用一片集成计数器构成二十进制,另一片构成四进制,然后串行连接即可

E.用一片集成计数器构成十二进制,另一片构成二进制,然后串行连接即可

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第8题

要利用两片集成计数器构成一个18进制计数器,可（)。

A.用一片集成计数器构成三进制,另一片构成六进制,然后串行连接即可

B.用一片集成计数器构成十进制,另一片也构成八进制,然后串行连接即可

C.用一片集成计数器构成九进制,另一片构成二进制,然后串行连接即可

D.用一片集成计数器构成九进制,另一片构成九进制,然后串行连接即可

E.用一片集成计数器构成十二进制,另一片构成六进制,然后串行连接即可

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第9题

并行(超前)进位加法器工作速度()，但电路();串行进位工速度()，但电路()。

并行（超前)进位加法器工作速度（)，但电路（);串行进位工速度（)，但电路（)。

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第10题

定点二进制运算器中，减法运算一般通过（)来实现的

A.原码运算的十进制加法器

B.补码运算的十进制加法器

C.原码运算的二进制加法器

D.补码运算的二进制加法器

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