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[多选题]

下面这段程序中,clk为时钟信号输入,set为复位信号,y1和y2驱动发光二极管,高电平点亮。set置0,待时钟上升沿,同步初始化;之后set置1,开始运行。则下列说法中正确的是:()。moduleLearn6_2(clk,set,y1,y2);inputclk,set;outputregy1,y2;rega1,a2;always@(posedgeclk)beginif(!set)begina1<=1;a2<=1;y1<=1;y2<=1;endelsebegina1=(~y1);y1=(~a1);a2<=(~y2);y2<=(~a2);endendendmodule

A.y1在时钟上升沿循环亮灭

B.y1保持常亮

C.y2在时钟上升沿循环亮灭

D.y2保持常亮

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第1题
某系统为了提高采样速率,采用4片模数(全并行A/D)转换器构成并行交替式数据采集系统,原理框图如

某系统为了提高采样速率,采用4片模数(全并行A/D)转换器构成并行交替式数据采集系统,原理框图如图7.20所示.系统信号源为30MHz的方波,时钟信号CLK为10MHz(要求占空比为1:1).并行交替式数据采集系统利用4片ADC轮流对同一个模拟输入信号进行采样,分别存人各路对应的64单元的存储器中,其对应各路AD所需的采样信号波形如图7.21所示,脉冲分配电路可用计数器+译码器构成.试根据系统设计参数要求,完成各部分电路的设计,器件任选.

(1)分频电路;

(2)脉冲分配电路;

(3)地址发生器电路设计;

(4)说明每个地址发生器所使用的时钟信号分别是什么?

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第2题
在以下程序中,Clk_50M为频率为50MHz的系统时钟,则下列说法中正确的有()。regClk;reg[31:0]Cnt;always@(posedgeClk_50MornegedgeRst)beginif(!Rst)beginCnt<=1;Clk<=1;endelsebeginif(Cnt>=25000000)beginCnt<=1;Clk<=~Clk;endelseCnt<=Cnt+1;endend

A.该模块为同步复位

B.该模块的功能是分频器

C.若系统时钟频率为50MHz,则输出Clk的频率为2MHz

D.该程序为时序逻辑电路

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第3题
画出图P5.4(a)中电平触发SR触发器Q和Q'端的电压波形。时钟脉冲CLK和输入S、R的电压波形如图P5.
画出图P5.4(a)中电平触发SR触发器Q和Q'端的电压波形。时钟脉冲CLK和输入S、R的电压波形如图P5.

4(b)所示。设触发器的初始状态为Q=0。

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第4题
以下哪些信号可以作为外部时钟接口的输入和输出信号使用()

A.2.048MHz

B.2.048Mbit/s

C.34Mbit/s

D.155Mbit/s

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第5题
8253-5工作于方式2时,若计数值为N时,每输入N个CLK脉冲,则输出()

A.正脉冲

B.高电平信号

C.低电平信号

D.一个负脉冲

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第6题
下列对于VSWD1单板接口描述正确的有()。

A.DBG/LMT 10M/100M/1000M自适应电接口,用于调试或本地维护的以太网接口

B.ETH1/ETH2 10GE/25GE光接口,用于BBU-AAU的连接

C.CLK 用于引入或输出1PPS+TOD时钟信号

D.SMA 用于连接GPS/北斗天线

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第7题
ZXCTN6200&6300的主控板CLK指示灯每1秒钟亮一次表示的时钟状态为?()

A.捕捉

B.保持

C.锁定

D.内时钟

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第8题
在MSOFTX3000中通过指令DSP CLK查看时钟状态。()
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第9题
下面哪种结论是错误的?()‎

A.系统的闭环传递函数与误差的传递函数有相同的特征方程

B.单位脉冲响应的拉氏变换就是系统的传递函数

C.信号1的拉氏变换是1/s

D.传递函数定义为系统输出的拉氏变换与输入拉氏变换之比

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第10题
UMG8900的时钟锁相状态包括()。

A.自由:表示R前UMG8900不同步于外同步基准,也不使川频率记忆技术以维持频率的准确性,CLK板输出木板晶体由振荡的时钟

B.快捕:表示CLK板正在快速锁相参考源时钟,一般在系统刚接入参考源时处于该状态,为一.个瞬间态,UMG8900刚上电后处于这种状态

C.跟踪:示CLK板此时已锁相基准参考源,其输Hi为根据参考源校准的时钟

D.仅持:当CLK板处于跟踪状态后,参考源丢失,此时CLK板锁相状态会从跟踪转入保持,表明此时CLK板以跟踪状态时保存的锁相参数输出时钟

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