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[主观题]

用16k×8位的SRAM芯片构成64K×16位的存储器,要求画出该存储器的组成逻辑框图。存储器容量为64K

×16位,其地址线为16位(A15—A0),数据线也是16位(D15—D0)SRAM芯片容量为16K×8位,其地址线为14位,数据线为8位,因此组成存储器时须字位同时扩展。

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第1题
某SRAM存储器芯片的存储容量为16K×7位,则它的地址线和数据线引脚相加的和为()。

A.12

B.13

C.21

D.22

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第2题
存储器芯片容量为64K*8位,则该芯片的地址线有()条。
存储器芯片容量为64K*8位,则该芯片的地址线有()条。

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第3题
用1MX8位SRAM芯片,设计1MX32位的SRAM存储器,画出逻辑连接图.

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第4题
国家规定的开本尺寸是采用的国际标准系列,现已定入国家行业标准GB£¯T1999内在全国执行。书刊本册现行开本尺寸主要是A系列规格,有以下几种:A4()297mm×210mm;A5(32k)210mm×148mm;A6(64k)144mm×105mm三种。

A.全张

B.对开

C.4k

D.16k

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第5题
用2片容量为16K×8b的RAM构成容量为32K×8b的RAM使用的方法是位扩展.()
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第6题
设计一个用SRAM构成的堆栈.

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第7题
一个16K×8位的存储器,其地址线和数据线的总和是______。A.48;B.46;C.17;D.22

一个16K×8位的存储器,其地址线和数据线的总和是______。

A.48;

B.46;

C.17;

D.22

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第8题
某SRAM芯片,其容量为1024×4位,则地址和数据引脚的数目分别为()。

A.10,4

B.5,4

C.10,8

D.5,8

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第9题
向SRAM芯片某个存储单元写入数据,该芯片控制信号组合是______。

A.片选有效,写入信号有效

B.片选有效,写入信号无效

C.片选无效,写入信号有效

D.片选无效,写入信号无效

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第10题
高速缓存Cache芯片一般用( )构成,主存儲器用( )构成。
高速缓存Cache芯片一般用()构成,主存儲器用()构成。

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第11题
用两片CT74LS290构成模32进制计数器.芯片如图5.20所示.

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