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[主观题]

设计一个四变量奇偶判别电路.要求当4个输入中有奇数个高电平1时电路输出高电平1,否则输出低电

平0.试用如图10.20所示的8选1数据选择器CT74151和必要的门电路实现.

设计一个四变量奇偶判别电路.要求当4个输入中有奇数个高电平1时电路输出高电平1,否则输出低电平0.试

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第1题
试用双4选1数据选择器74153和少量门设计一个有4个输入X3、X2、X1、X0和2个输出Y≇

试用双4选1数据选择器74153和少量门设计一个有4个输入X3、X2、X1、X0和2个输出Y1、Y0的逻辑电路.电路输入为余3BCD码,输出为用2位二进制数表示的输入码中“1”的个数,例如,当输入X3X2X1X0=1010时,输出Y1Y0=10.当非余3码(伪码)输入时,要求输出Y1Y0=00.要求写出设计过程,画出电路图(规定X3、X2分别和数据选揮器地址码的高、低位相连接,74153的逻辑符号和功能表分别如图10.43和表10.6所示).

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第2题
试用译码器74LS138和适当的逻辑门设计一个三输入变量的判奇电路(判别1的个数是否为奇数)。
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第3题
设计一个三变量的多数表决电路.当输入变量中有两个或两个以上同意时,提议被通过,否则,提议不被通过.具体设计要求如下:(1)全用与非门来实现最简的逻辑电路;(2)用74138来实现,画出逻辑电路图.

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第4题
设计一个数据处理电路,输入数据A和B各为4位二进制数。当A>B时,要求给出A>B的信号和A-B的数值;当A<B时,要求给出A<B的信号和B-A的数值。

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第5题
试用74LS161、74LS138和少量门电路设计一个受X控制的双序列码产生电路。要求:当X=0时,Z1=0, Z2=0;当X=1时,Z1=1100101, Z2= 1001101。

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第6题
设计一个三变量判奇电路(输入中有奇数个变量为1,其输出就为1),其逻辑表达式为()。

A.

B.

C.

D.

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第7题
某操作员在对一个完好的控制回路进行时,当输入了某个干扰信号,但是被控变量一段时间后仍然没有变化,这个干扰也属于该系统的干扰信号。()
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第8题
利用集成二进制计数器CT74163和必要的门电路,设计一个分频器.当输入X为1Hz方波时,输出Y为60Hz
方波(占空比为1).要求采用模10计数器和模6计数器串联设计.画出整个电路的逻辑电路连接图,并做出每一个CT74163器件的状态转移图.CT74163的逻辑符号如图10.106所示.

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第9题
试用1片八D锁存器74HC373设计一个能锁存两组BCD码信号的锁存电路。假定三态输出使能端,锁存器原

试用1片八D锁存器74HC373设计一个能锁存两组BCD码信号的锁存电路。假定三态输出使能端,锁存器原输出为,输入为,画出锁存器锁存新数据前、后使能端LE应输入的波形和相应Q0的波形。

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第10题
问题描述:给定n个正整数和4个运算符+、-、*、/,且运算符无优先级,如2+3*5-25.对于任意给定的整数m
,试设计一个算法,用以上给出的n个数和4个运算符,产生整数m,且用的运算次数最少.给出的n个数中每个数最多只能用一次,但每种运算符可以任意使用.

算法设计:对于给定的n个正整数,设计一个优先队列式分支限界法,用最少的无优先级运算次数产生整数m.

数据输入:由文件input.txt给出输入数据.第1行有2个正整数n和m.第2行是给定的用于运算的n个正整数.

结果输出:将计算的产生整数m的最少无优先级运算次数以及最优无优先级运算表达式输出到文件output.txt.

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