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[主观题]
Verilog的基本设计单元是模块。它是由两部分组成，一部分()，一部分描述()，即定义输入是如何影响输出的。
Verilog的基本设计单元是模块。它是由两部分组成，一部分（)，一部分描述（)，即定义输入是如何影响输出的。
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B.求解有回路、或设计、优化型问题时，可直接求解，不需要迭代，与序贯模块法相比，具有更大的灵活性和较高的计算效率
C.采用有效而可靠的方法求解系统的线性模型，可大大提高收敛速度
D.可以利用序贯模块法中已有的模块进行单元模型线性化计算，具有继承性
E.与联立方程法相比，线性近似模型中单元过程的内部状态变量不可现，只处理流程水平的简化方程组，因而能处理更大规模的问题
A.思维导图
B.整合各阶段知识
C.深入理解基础知识
D.进行单元小结
