图P5.8(b)所示。设触发器的初始状态为Q=0。
画出图P5.10(a)中边沿触发D触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入端D的电压波形如图P5.10(b)所示。设触发器的初始状态为Q=0。
在图P5.12(a)下降触发D触发器中,已知时钟脉冲CLK、输入端D、异步置位输入端RD和异步复位输入端RD的电压波形如图P5.12(b)中所示,试画出输出端Q对应的电压波形。
主从JK触发器组成如图P4.4(a)所示的电路,已知电路的输入波形如图P4.4(b)所示,画出Q1端和Q2端的波形.设初始状态Q=0.
电路如图3.9(a)所示.触发器为JK触发器,设初始状态均为0.试按图3.9(b)给定的输入信号波形画出输出Q1、Q2端的波形.
TTL边沿触发器组成的电路分别如图P4.8(a)和(b)所示,其输入波形如图P4.8(c)所示,试分别画出Q1和Q2端的波形.设各电路的初始状态均为0.
画出触发器输出端Q对应的电压波形。
4(b)所示。设触发器的初始状态为Q=0。