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[主观题]

利用集成二进制计数器CT74163和必要的门电路,设计一个分频器.当输入X为1Hz方波时,输出Y为60Hz

方波(占空比为1).要求采用模10计数器和模6计数器串联设计.画出整个电路的逻辑电路连接图,并做出每一个CT74163器件的状态转移图.CT74163的逻辑符号如图10.106所示.

利用集成二进制计数器CT74163和必要的门电路,设计一个分频器.当输入X为1Hz方波时,输出Y为6

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第1题

要利用两片集成计数器构成一个18进制计数器,可（)。

A.用一片集成计数器构成三进制,另一片构成六进制,然后串行连接即可

B.用一片集成计数器构成十进制,另一片也构成八进制,然后串行连接即可

C.用一片集成计数器构成九进制,另一片构成二进制,然后串行连接即可

D.用一片集成计数器构成九进制,另一片构成九进制,然后串行连接即可

E.用一片集成计数器构成十二进制,另一片构成六进制,然后串行连接即可

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第2题

要利用两片集成计数器构成一个24进制计数器,可（)。

A.用一片集成计数器构成三进制,另一片构成八进制,然后串行连接即可

B.用一片集成计数器构成十二进制,另一片也构成十二进制,然后串行连接即可

C.用一片集成计数器构成四进制,另一片构成六进制,然后串行连接即可

D.用一片集成计数器构成二十进制,另一片构成四进制,然后串行连接即可

E.用一片集成计数器构成十二进制,另一片构成二进制,然后串行连接即可

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第3题

分析图3.20所示的电路构成模几计数器？已知电路中采用的中规模集成计数器为同步四位二进制计数

器.

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第4题

使用同步二进制计数器74LS161及必要的门电路设计一个模100计数器.

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第5题

假定有一8253接在系统中,其端口地址为分配如下：0#计数器为220H，1#计数器为221H2#计数器为222H

，控制口为223H，利用0#计数器高8位计数，计数值为256，二进制方式，选用方式3工作，试编程初始化。

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第6题

试利用两片4位二进制并行加法器741S283和必要的门电路.组成1位二-是进制加法器电路.(根据二-十进制数的加法运算规则,当两数之和小于、等于9(1001)时,相加的结果和按二进制数相加所得到的结果一样.当两数之和大于9(即等于1010~111)时,则应在按二进制数相加的结果上加6(0110),这样就以给出进位信号,同时得到一个小于9的和.)

试利用两片4位二进制并行加法器741S283和必要的门电路.组成1位二-是进制加法器电路.（根据二-十进制数的加法运算规则,当两数之和小于、等于9（1001)时,相加的结果和按二进制数相加所得到的结果一样.当两数之和大于9（即等于1010~111)时,则应在按二进制数相加的结果上加6（0110),这样就以给出进位信号,同时得到一个小于9的和.)

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第7题

一片中规模集成计数器74LS161有()个引脚

一片中规模集成计数器74LS161有（)个引脚

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第8题

按计数进制的不同，可将计数器分为二进制，十进制和N进制计数器等类型。（)

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第9题

中规模集成计数器74LS161异步复位端（)电平有效。

A.高电平

B.低电平

C.任意电平有效

D.取决于控制端ENP和ENT

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第10题

用ISP技术设计一个可控计数器.当控制信号X=0时,为8421码十进制计数器;当X=1时,为4位二进制计数器.用VHDL语言写出设计源文件.

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